mirror of https://github.com/F-Stack/f-stack.git
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/* SPDX-License-Identifier: BSD-3-Clause
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* Copyright(c) 2010-2015 Intel Corporation
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*/
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#include "rte_cpuflags.h"
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#include <stdio.h>
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#include <errno.h>
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#include <stdint.h>
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#include <string.h>
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#include "rte_cpuid.h"
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/**
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* Struct to hold a processor feature entry
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*/
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struct feature_entry {
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uint32_t leaf; /**< cpuid leaf */
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uint32_t subleaf; /**< cpuid subleaf */
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uint32_t reg; /**< cpuid register */
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uint32_t bit; /**< cpuid register bit */
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#define CPU_FLAG_NAME_MAX_LEN 64
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char name[CPU_FLAG_NAME_MAX_LEN]; /**< String for printing */
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};
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#define FEAT_DEF(name, leaf, subleaf, reg, bit) \
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[RTE_CPUFLAG_##name] = {leaf, subleaf, reg, bit, #name },
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const struct feature_entry rte_cpu_feature_table[] = {
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FEAT_DEF(SSE3, 0x00000001, 0, RTE_REG_ECX, 0)
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FEAT_DEF(PCLMULQDQ, 0x00000001, 0, RTE_REG_ECX, 1)
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FEAT_DEF(DTES64, 0x00000001, 0, RTE_REG_ECX, 2)
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FEAT_DEF(MONITOR, 0x00000001, 0, RTE_REG_ECX, 3)
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FEAT_DEF(DS_CPL, 0x00000001, 0, RTE_REG_ECX, 4)
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FEAT_DEF(VMX, 0x00000001, 0, RTE_REG_ECX, 5)
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FEAT_DEF(SMX, 0x00000001, 0, RTE_REG_ECX, 6)
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FEAT_DEF(EIST, 0x00000001, 0, RTE_REG_ECX, 7)
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FEAT_DEF(TM2, 0x00000001, 0, RTE_REG_ECX, 8)
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FEAT_DEF(SSSE3, 0x00000001, 0, RTE_REG_ECX, 9)
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FEAT_DEF(CNXT_ID, 0x00000001, 0, RTE_REG_ECX, 10)
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FEAT_DEF(FMA, 0x00000001, 0, RTE_REG_ECX, 12)
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FEAT_DEF(CMPXCHG16B, 0x00000001, 0, RTE_REG_ECX, 13)
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FEAT_DEF(XTPR, 0x00000001, 0, RTE_REG_ECX, 14)
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FEAT_DEF(PDCM, 0x00000001, 0, RTE_REG_ECX, 15)
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FEAT_DEF(PCID, 0x00000001, 0, RTE_REG_ECX, 17)
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FEAT_DEF(DCA, 0x00000001, 0, RTE_REG_ECX, 18)
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FEAT_DEF(SSE4_1, 0x00000001, 0, RTE_REG_ECX, 19)
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FEAT_DEF(SSE4_2, 0x00000001, 0, RTE_REG_ECX, 20)
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FEAT_DEF(X2APIC, 0x00000001, 0, RTE_REG_ECX, 21)
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FEAT_DEF(MOVBE, 0x00000001, 0, RTE_REG_ECX, 22)
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FEAT_DEF(POPCNT, 0x00000001, 0, RTE_REG_ECX, 23)
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FEAT_DEF(TSC_DEADLINE, 0x00000001, 0, RTE_REG_ECX, 24)
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FEAT_DEF(AES, 0x00000001, 0, RTE_REG_ECX, 25)
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FEAT_DEF(XSAVE, 0x00000001, 0, RTE_REG_ECX, 26)
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FEAT_DEF(OSXSAVE, 0x00000001, 0, RTE_REG_ECX, 27)
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FEAT_DEF(AVX, 0x00000001, 0, RTE_REG_ECX, 28)
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FEAT_DEF(F16C, 0x00000001, 0, RTE_REG_ECX, 29)
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FEAT_DEF(RDRAND, 0x00000001, 0, RTE_REG_ECX, 30)
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FEAT_DEF(HYPERVISOR, 0x00000001, 0, RTE_REG_ECX, 31)
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FEAT_DEF(FPU, 0x00000001, 0, RTE_REG_EDX, 0)
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FEAT_DEF(VME, 0x00000001, 0, RTE_REG_EDX, 1)
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FEAT_DEF(DE, 0x00000001, 0, RTE_REG_EDX, 2)
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FEAT_DEF(PSE, 0x00000001, 0, RTE_REG_EDX, 3)
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|
FEAT_DEF(TSC, 0x00000001, 0, RTE_REG_EDX, 4)
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|
FEAT_DEF(MSR, 0x00000001, 0, RTE_REG_EDX, 5)
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|
FEAT_DEF(PAE, 0x00000001, 0, RTE_REG_EDX, 6)
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FEAT_DEF(MCE, 0x00000001, 0, RTE_REG_EDX, 7)
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|
FEAT_DEF(CX8, 0x00000001, 0, RTE_REG_EDX, 8)
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FEAT_DEF(APIC, 0x00000001, 0, RTE_REG_EDX, 9)
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FEAT_DEF(SEP, 0x00000001, 0, RTE_REG_EDX, 11)
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FEAT_DEF(MTRR, 0x00000001, 0, RTE_REG_EDX, 12)
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FEAT_DEF(PGE, 0x00000001, 0, RTE_REG_EDX, 13)
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FEAT_DEF(MCA, 0x00000001, 0, RTE_REG_EDX, 14)
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FEAT_DEF(CMOV, 0x00000001, 0, RTE_REG_EDX, 15)
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|
FEAT_DEF(PAT, 0x00000001, 0, RTE_REG_EDX, 16)
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|
FEAT_DEF(PSE36, 0x00000001, 0, RTE_REG_EDX, 17)
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|
FEAT_DEF(PSN, 0x00000001, 0, RTE_REG_EDX, 18)
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|
FEAT_DEF(CLFSH, 0x00000001, 0, RTE_REG_EDX, 19)
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|
FEAT_DEF(DS, 0x00000001, 0, RTE_REG_EDX, 21)
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|
FEAT_DEF(ACPI, 0x00000001, 0, RTE_REG_EDX, 22)
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|
FEAT_DEF(MMX, 0x00000001, 0, RTE_REG_EDX, 23)
|
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|
FEAT_DEF(FXSR, 0x00000001, 0, RTE_REG_EDX, 24)
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|
FEAT_DEF(SSE, 0x00000001, 0, RTE_REG_EDX, 25)
|
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|
|
FEAT_DEF(SSE2, 0x00000001, 0, RTE_REG_EDX, 26)
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|
FEAT_DEF(SS, 0x00000001, 0, RTE_REG_EDX, 27)
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|
FEAT_DEF(HTT, 0x00000001, 0, RTE_REG_EDX, 28)
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|
FEAT_DEF(TM, 0x00000001, 0, RTE_REG_EDX, 29)
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|
FEAT_DEF(PBE, 0x00000001, 0, RTE_REG_EDX, 31)
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FEAT_DEF(DIGTEMP, 0x00000006, 0, RTE_REG_EAX, 0)
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FEAT_DEF(TRBOBST, 0x00000006, 0, RTE_REG_EAX, 1)
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|
FEAT_DEF(ARAT, 0x00000006, 0, RTE_REG_EAX, 2)
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|
FEAT_DEF(PLN, 0x00000006, 0, RTE_REG_EAX, 4)
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|
FEAT_DEF(ECMD, 0x00000006, 0, RTE_REG_EAX, 5)
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|
FEAT_DEF(PTM, 0x00000006, 0, RTE_REG_EAX, 6)
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FEAT_DEF(MPERF_APERF_MSR, 0x00000006, 0, RTE_REG_ECX, 0)
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FEAT_DEF(ACNT2, 0x00000006, 0, RTE_REG_ECX, 1)
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|
FEAT_DEF(ENERGY_EFF, 0x00000006, 0, RTE_REG_ECX, 3)
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FEAT_DEF(FSGSBASE, 0x00000007, 0, RTE_REG_EBX, 0)
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|
FEAT_DEF(BMI1, 0x00000007, 0, RTE_REG_EBX, 2)
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FEAT_DEF(HLE, 0x00000007, 0, RTE_REG_EBX, 4)
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|
FEAT_DEF(AVX2, 0x00000007, 0, RTE_REG_EBX, 5)
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|
FEAT_DEF(SMEP, 0x00000007, 0, RTE_REG_EBX, 6)
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|
FEAT_DEF(BMI2, 0x00000007, 0, RTE_REG_EBX, 7)
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|
FEAT_DEF(ERMS, 0x00000007, 0, RTE_REG_EBX, 8)
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|
FEAT_DEF(INVPCID, 0x00000007, 0, RTE_REG_EBX, 10)
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FEAT_DEF(RTM, 0x00000007, 0, RTE_REG_EBX, 11)
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|
FEAT_DEF(AVX512F, 0x00000007, 0, RTE_REG_EBX, 16)
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|
FEAT_DEF(RDSEED, 0x00000007, 0, RTE_REG_EBX, 18)
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FEAT_DEF(WAITPKG, 0x00000007, 0, RTE_REG_ECX, 5)
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|
FEAT_DEF(LAHF_SAHF, 0x80000001, 0, RTE_REG_ECX, 0)
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|
FEAT_DEF(LZCNT, 0x80000001, 0, RTE_REG_ECX, 4)
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|
FEAT_DEF(SYSCALL, 0x80000001, 0, RTE_REG_EDX, 11)
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|
FEAT_DEF(XD, 0x80000001, 0, RTE_REG_EDX, 20)
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|
FEAT_DEF(1GB_PG, 0x80000001, 0, RTE_REG_EDX, 26)
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|
FEAT_DEF(RDTSCP, 0x80000001, 0, RTE_REG_EDX, 27)
|
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|
FEAT_DEF(EM64T, 0x80000001, 0, RTE_REG_EDX, 29)
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|
FEAT_DEF(INVTSC, 0x80000007, 0, RTE_REG_EDX, 8)
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|
FEAT_DEF(AVX512DQ, 0x00000007, 0, RTE_REG_EBX, 17)
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|
FEAT_DEF(AVX512IFMA, 0x00000007, 0, RTE_REG_EBX, 21)
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|
FEAT_DEF(AVX512CD, 0x00000007, 0, RTE_REG_EBX, 28)
|
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|
FEAT_DEF(AVX512BW, 0x00000007, 0, RTE_REG_EBX, 30)
|
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|
FEAT_DEF(AVX512VL, 0x00000007, 0, RTE_REG_EBX, 31)
|
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|
FEAT_DEF(AVX512VBMI, 0x00000007, 0, RTE_REG_ECX, 1)
|
||
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|
FEAT_DEF(AVX512VBMI2, 0x00000007, 0, RTE_REG_ECX, 6)
|
||
|
|
FEAT_DEF(GFNI, 0x00000007, 0, RTE_REG_ECX, 8)
|
||
|
|
FEAT_DEF(VAES, 0x00000007, 0, RTE_REG_ECX, 9)
|
||
|
|
FEAT_DEF(VPCLMULQDQ, 0x00000007, 0, RTE_REG_ECX, 10)
|
||
|
|
FEAT_DEF(AVX512VNNI, 0x00000007, 0, RTE_REG_ECX, 11)
|
||
|
|
FEAT_DEF(AVX512BITALG, 0x00000007, 0, RTE_REG_ECX, 12)
|
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|
FEAT_DEF(AVX512VPOPCNTDQ, 0x00000007, 0, RTE_REG_ECX, 14)
|
||
|
|
FEAT_DEF(CLDEMOTE, 0x00000007, 0, RTE_REG_ECX, 25)
|
||
|
|
FEAT_DEF(MOVDIRI, 0x00000007, 0, RTE_REG_ECX, 27)
|
||
|
|
FEAT_DEF(MOVDIR64B, 0x00000007, 0, RTE_REG_ECX, 28)
|
||
|
|
FEAT_DEF(AVX512VP2INTERSECT, 0x00000007, 0, RTE_REG_EDX, 8)
|
||
|
|
};
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|
|
|
||
|
|
int
|
||
|
|
rte_cpu_get_flag_enabled(enum rte_cpu_flag_t feature)
|
||
|
|
{
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const struct feature_entry *feat;
|
||
|
|
cpuid_registers_t regs;
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unsigned int maxleaf;
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|
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|
||
|
|
if (feature >= RTE_CPUFLAG_NUMFLAGS)
|
||
|
|
/* Flag does not match anything in the feature tables */
|
||
|
|
return -ENOENT;
|
||
|
|
|
||
|
|
feat = &rte_cpu_feature_table[feature];
|
||
|
|
|
||
|
|
if (!feat->leaf)
|
||
|
|
/* This entry in the table wasn't filled out! */
|
||
|
|
return -EFAULT;
|
||
|
|
|
||
|
|
maxleaf = __get_cpuid_max(feat->leaf & 0x80000000, NULL);
|
||
|
|
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||
|
|
if (maxleaf < feat->leaf)
|
||
|
|
return 0;
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||
|
|
|
||
|
|
__cpuid_count(feat->leaf, feat->subleaf,
|
||
|
|
regs[RTE_REG_EAX], regs[RTE_REG_EBX],
|
||
|
|
regs[RTE_REG_ECX], regs[RTE_REG_EDX]);
|
||
|
|
|
||
|
|
/* check if the feature is enabled */
|
||
|
|
return (regs[feat->reg] >> feat->bit) & 1;
|
||
|
|
}
|
||
|
|
|
||
|
|
const char *
|
||
|
|
rte_cpu_get_flag_name(enum rte_cpu_flag_t feature)
|
||
|
|
{
|
||
|
|
if (feature >= RTE_CPUFLAG_NUMFLAGS)
|
||
|
|
return NULL;
|
||
|
|
return rte_cpu_feature_table[feature].name;
|
||
|
|
}
|
||
|
|
|
||
|
|
void
|
||
|
|
rte_cpu_get_intrinsics_support(struct rte_cpu_intrinsics *intrinsics)
|
||
|
|
{
|
||
|
|
memset(intrinsics, 0, sizeof(*intrinsics));
|
||
|
|
|
||
|
|
if (rte_cpu_get_flag_enabled(RTE_CPUFLAG_WAITPKG)) {
|
||
|
|
intrinsics->power_monitor = 1;
|
||
|
|
intrinsics->power_pause = 1;
|
||
|
|
}
|
||
|
|
}
|